先端半導体パッケージの開発動向と今後の展望

本講演では、AI時代の進展を背景に、先端半導体パッケージ技術の開発動向と今後の展望を体系的に解説する。 Generative AI から Physical AI へと進化する中で、情報処理量の爆発的増大が半導体に求める性能・電力・実装密度の要求を押し上げている。 　これに対し、More-Moore に加え More-Than-Moore の観点から、Fan-Out、Embedded、2.5D/3D 実装など多様な実装技術が進化してきた。特にチップレット化は、歩留まり・設計柔軟性・システム最適化の観点から重要性を増しており、Intel、TSMC、Samsung、AMD など各社の技術戦略を比較する。 　さらに AI/HPC を牽引する CoWoS を軸に、Hybrid Bonding、微細配線、裏面電源供給、Glass基板といった要素技術と量産課題を整理し、今後のパッケージング技術が果たす役割と新たなソリューションへの期待を展望する。 　本講演を通じて、AI時代における半導体性能向上の本質的課題と、それを支える先端パッケージ技術の全体像を体系的に理解できる。Flip Chip、Fan-Out、2.5D/3D 実装、チップレットなど主要実装技術の位置づけと技術的特徴を整理し、More-Moore/More-Than-Moore の両軸から設計思想を把握する。さらに Intel、TSMC、Samsung、AMD 各社のチップレット戦略や、CoWoS に代表される AI/HPC 向け実装の要点を学ぶことで、今後の製品企画・研究開発・実装技術選定に活かせる俯瞰的な判断力を習得できる。

1. 背景
   1. AI時代の幕開け、Generative AI, Agentive AI から Physical AIへ
   2. 情報爆発/処理データの増大と、半導体に求められる性能向上
   3. More-MooreかMore-Than-Mooreか
2. エレクトロニクス/半導体実装の現状
   1. 実装技術の変遷と現状
   2. System Integrationとは
   3. 業界の水平分業化
3. 実装技術、ソリューションの提案、現状と課題、各社の事例
   1. Flip Chip/Wire Bonding Package
   2. Fan – Out Package
   3. Embedded Technology
   4. 2.1/2.3/2.5/3D Package
   5. 5Gから6Gへ、要求される実装技術
4. 『チップレット』への取り組み
   1. Chipletとは
   2. ダイの小形化による効果とチップレット
5. Chiplet Integration/Multi Die Solutionの現状
   1. Intel
   2. TSMC
   3. Samsung
   4. Rapidus
   5. AMD
   6. Others
      • Huawei
      • Baidu
      • Fujitsu
      • アオイ電子工業
6. AIが求めるパッケージング技術, CoWoSが牽引するこれからのAIとは
   1. CoWoS とは
   2. どのように付けるか (Inter-connectionと Hybrid Bonding)
   3. どのように繋ぐか (Wiring/Net-working, 微細配線技術/裏面電源供給)
   4. 実用・量産 (アッセンブリなど) のための課題は
   5. 最先端半導体、性能を決めるSubstrate/Interposer基板
      (Glass基板技術のこれから)
   6. 新たなSolutionへの期待
7. まとめ
• 質疑応答